孙承绶
- 作品数：26 被引量：68H指数：5
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- 相关领域：电子电信自动化与计算机技术自然科学总论更多>>
- 基为4的可扩展模乘运算器设计
- 2006年
- 基于基为4的Montgomery模乘算法和改进的流水线组织结构,文章提出了一种结构优化的可扩展模乘运算器结构。设计中采用了按字运算的模乘算法,使本设计具有很好的可扩展性,它可以完成任意位数的模乘运算。同时,因为模乘运算器的运算数据通路采用多级处理单元的流水线结构,所以设计时可以很方便进行配置,以达到模乘运算器硬件成本和运算性能的折衷。分析结果显示,文章提出的模乘运算器结构具有很高的效率和很好的可扩展性。
- 麻永新曾晓洋顾叶华孙承绶
- 关键词：模乘运算
- 适用于衰落移动信道的直接序列扩谱码的自适应截获
- 2001年
- 在移动通信中,鉴于接收信号的特性,对扩谱码的截获采用固定阈值技术难以获得满意效果。因此,我们考虑引入扩谱码自适用截获技术,这一算法是在保持虚警概率不变的情况下,基于背景功率级的评估,然后将评估值与阈值系数相乘,并将乘积结果作为判定阈值。模拟表明,对于衰落移动信道,扩谱码的截获性能相当令人满意。
- 沈飞孙承绶
- 关键词：直接序列扩谱伪随机码
- FPGA芯片中边界扫描电路的设计实现被引量：3
- 2007年
- 应用在FPGA芯片中的边界扫描电路侧重于电路板级测试,兼顾芯片功能测试,同时提供JTAG下载方式。FPGA芯片的规模越来越大,引脚数目越来越多,边界扫描单元也随之相应增加。在此情况下,边界扫描电路设计时为了避免移入错误数据,对时钟偏差提出了很高的要求。同时,由于扫描链包含大量的边界扫描单元,在板级测试时,大大降低了有效测试速率。针对这两个问题,提出了对边界扫描单元的改进方式,改进后的边界扫描电路不仅可实现测试、编程功能,而且大大提高了电路抗竞争能力,保证电路正常工作。改进后的电路使边界扫描寄存器链的长度可以改变,使有效测试速率提高了20倍左右。
- 于薇来金梅孙承绶童家榕
- 关键词：现场可编程门阵列时钟偏差板级测试
- USB2.0SIE的ASIC设计与实现被引量：2
- 2004年
- 简要分析了 USB 体系结构,参考 USB2.0 标准构造了 USB 设备芯片的通信模型。基于这个模型,对 USB 设备芯片的核心——串行接口引擎(SIE)进行了结构的划分和设计。所设计的SIE 在 FPGA 上通过了硬件验证。
- 杜占坤吴敏李铮邬斌浩孙承绶
- 关键词：USB设备USB2.0标准串行接口引擎通信模型硬件验证
- 全兼容IEEE1149.1的MIPS CPU CORE可测性设计被引量：5
- 2004年
- 提出了一种采用软硬件协同工作的方式来实现MIPSCPUCORE的可测性设计(DFT)方案。硬件全兼容IEEE1149.1(JTAG)标准,支持单步、断点(6个),内部关键寄存器的查看,并具有可扩充性;软件采用GUI编程开发,达到可视化DEBUG。本设计对于减少CPU开发的测试成本,提高开发效率,以及CPU测试DFT策略的经验积累,都有着一定的意义。
- 陆正毅孙承绶程君侠
- 关键词：可测性设计软硬件协同设计JTAG
- 用于高速PLL的CMOS电荷泵电路被引量：14
- 2005年
- 提出了一种应用于高速锁相环中的新型CMOS电荷泵电路.电荷泵核心部分为一带有参考电压电路的双管开关型电路,并对运放构成的反馈回路进行了改进,降低了电荷泵输出电压的抖动.电路采用chartered 0.35 μm 3.3 V CMOS工艺实现,模拟结果表明电流源输出电压在1～3 V区间变化,其输出电流基本无变化,上下电流的失配率小于0.6%,具有很高的匹配性.在3.3 V电源电压下,电荷泵输出电压的范围为0～3.1 V,具有宽摆幅和低抖动(约0.2 mV)等优点,能很好地满足高速锁相环的性能要求.
- 王烜来金梅孙承绶章倩苓
- 关键词：半导体技术电荷泵鉴频鉴相器压控振荡器
- 一种非接触式IC卡控制器的设计被引量：10
- 2000年
- 介绍了 ISO/ IEC144 4 3中 Type B类型非接触式 IC卡实现抗冲突的算法 ,设计了一种适用于非接触式IC卡的具有抗冲突功能控制逻辑的 VL SI结构 ,并用 VHDL 语言进行了仿真。电路中提出了确定时间片的伪随机算法来实现抗冲突功能。用 1μm CMOS单元库进行综合 ,在 2 0 MHz时钟频率下 ,电路的规模为 70 0 0门左右 ,关键路径延时为 46 ns。该电路可应用于实际的非接触式 IC卡控制器 。
- 肖斌秦东徐志伟孙承绶
- 关键词：非接触式IC卡控制器
- 低成本的密钥长度可配置RSA密码协处理器VLSI设计被引量：1
- 2006年
- 采用基于字运算的高基Montgomery模乘算法,并且应用了改进的流水线组织结构,以较小的硬件开销实现了一个密钥长度最高可达2048bits、速度面积比性能很高的RSA密码协处理器.VLSI实现结果显示:不包含存储器的核心电路规模仅相当于18000等效门;基于0.25μmCMOS工艺,在180MHz的时钟频率下,1024bits的RSA加密速率可达28Kbps.该RSA密码协处理器非常适合于如智能IC卡等面积局限性高、成本敏感的产品中.
- 麻永新曾晓洋吴敏孙承绶
- 关键词：密码协处理器可配置
- 基于MOSFET PDE模型的射频电路周期稳态分析
- 2004年
- 研究了基于 MOSFET PDE模型的射频电路周期稳态分析有效算法 :通过恰当的系统解耦、松弛迭代和边值问题求解等方法避免了复杂的 PDE周期稳态分析 ,较好地解决了基于 MOSFET PDE模型的射频电路周期稳态分析的计算效率问题。采用该算法仿真典型的 C类功率放大器得到电流波形和工业界公认标准器件仿真器 MEDICI瞬态模拟得到电流波形比较 ,显示出很好的一致性。
- 来金梅武新宇孙承绶任俊彦章倩苓Omar Wing
- 关键词：MOSFETPDE射频电路电流波形
- 双频激励耦合PDE-AE射频系统的准周期稳态响应模拟算法研究
- 2003年
- 本文结合谐波平衡思想 ,提出在空间上离散MOSFET偏微分方程 ,建立与之相应的混合型多变量谐波平衡方程 ,扩展了谐波平衡方程的应用范围 .为了有效地完成这种复杂混合型多变量谐波平衡方程的求解 ,运用谐波平衡方程的同解变换、初始值预估以及阻尼Newton迭代算法等策略 ,使算法的收敛速度和计算性能都有大幅度提高 .以单平衡混频器为例的模拟结果进一步显示该方法不但能有效地反映出射频电路MOSFET器件的分布特性 ,且算法计算性能对频差变化不灵敏 。
- 武新宇来金梅孙承绶任俊彦章倩苓
- 关键词：射频集成电路稳态响应混频器PDE
