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张防震

作品数:5 被引量:1H指数:1
供职机构:郑州大学更多>>
发文基金:国家自然科学基金更多>>
相关领域:电子电信自动化与计算机技术更多>>

文献类型

  • 4篇期刊文章
  • 1篇学位论文

领域

  • 4篇电子电信
  • 1篇自动化与计算...

主题

  • 4篇高速串行
  • 4篇高速串行接口
  • 3篇负反馈
  • 2篇数字化
  • 1篇电路
  • 1篇电路设计
  • 1篇硬件
  • 1篇硬件描述语言
  • 1篇设计方法
  • 1篇设计实现
  • 1篇数字化技术
  • 1篇芯片
  • 1篇逻辑器件
  • 1篇描述语言
  • 1篇模拟技术
  • 1篇接口
  • 1篇接收器
  • 1篇可编程逻辑
  • 1篇可编程逻辑器...
  • 1篇基于FPGA

机构

  • 5篇郑州大学
  • 1篇西北大学

作者

  • 5篇张防震
  • 4篇李浩亮
  • 2篇李常青
  • 1篇贾恒
  • 1篇邓记才
  • 1篇杨森

传媒

  • 2篇郑州大学学报...
  • 2篇商丘职业技术...

年份

  • 3篇2009
  • 2篇2008
5 条 记 录,以下是 1-5
排序方式:
高精度片上匹配电阻的设计实现
2009年
基于负反馈动态调整原理和数字化的模拟电路设计技术,本文设计了一种可调多晶硅电阻条的有源高精度片上匹配电阻电路.使用TSMC的CMOS0.25um混合信号模型,在Cadence软件环境下用spectre仿真器模拟,结果表明在500M bps的高速时钟信号作用下,所设计的匹配电阻阻值稳定在[44.3Ω,45.6Ω]范围内,最大稳定时间6μs,平均误差为±1.45%,所设计电阻平均变化范围为45Ω±1.45%,最大误差范围1.56%,高于45Ω±10%的高速串行接口协议要求.
张防震杨森李浩亮
关键词:高速串行接口负反馈数字化模拟技术
基于FPGA的PCI接口的设计
PCI(Peripheral Component Interconnect)局部总线是微型计算机中处理器、存储器与外围控制部件、扩展卡之间的互连接口,由于其速度快、可靠性高、成本低、兼容性好等特点,在各种计算机总线标准占...
张防震
关键词:PCI接口设计方法可编程逻辑器件FPGA芯片硬件描述语言
文献传递
一种新颖的高精度多相时钟发生电路设计被引量:1
2008年
本文设计了一种新颖的单片集成、适用于高速串行通信接口接收端和数据恢复电路的等间距高精度五相时钟发生电路.基于负反馈动态调整原理和数字化的模拟电路设计技术,电路采用TSMC(Taiwan Semiconduc-tor Manufacturing Company Ltd)的CMOS 0.25um工艺设计和后仿真,实验结果表明:时钟发生电路可正确输出五相时钟,周期均为2.08 ns(频率480 Mbps);相互间隔0.416 ns,抖动为35 ps,锁定时间为1.8 us,满足高速串行通信接口接收端和数据恢复电路对五相时钟的要求.
李浩亮张防震
关键词:高速串行接口负反馈
一种新颖的高精度片上匹配电阻电路设计
2008年
采用数字化端子控制技术,基于负反馈动态调整原理和可调多晶硅电阻条,设计了新颖的、符合高速串行接口USB2.0协议要求的高精度片上匹配电阻电路.使用TSMC的CMOS 0.25μm混合信号模型,在Cadence软件环境下用spectre仿真器模拟,结果表明在500 Mbps的高速时钟信号作用下,所设计的匹配电阻阻值在[44.3Ω,45.6Ω]范围内,最大稳定时间6μs,平均误差为±1.45%,所设计电阻平均变化范围为45×(1±1.45%)Ω,最大误差范围1.56%,达到并高于45×(1±10%)Ω的高速串行接口协议要求.
李浩亮李常青邓记才张防震
关键词:高速串行接口负反馈
基于数字化技术的高速串行接收器设计
2009年
基于数字化模拟电路设计技术和自适应动态反馈方法设计了一个高速串行接收器,包含采样放大器、时钟发生电路、匹配电阻电路.后两者的精度直接决定了接收器性能.采用TSMC的CMOS 0.25μm混合信号模型,在Cadence软件环境下用spectre仿真器进行模拟.结果表明,时钟发生电路输出的五相时钟间隔0.416 ns,抖动35 ps,锁定时间1.8μs;匹配电阻阻值波动在44.3~45.6Ω,稳定时间6μs,平均误差±1.45%,最大误差1.56%.联调后整个接收器电路具有接收480 Mbps高速串行数据的能力.
李浩亮贾恒李常青张防震
关键词:高速串行接口接收器
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